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單項(xiàng)選擇題inout端口可以定義成下列哪種數(shù)據(jù)類(lèi)型（）。

A.reg類(lèi)型
B.net類(lèi)型
C.reg或net類(lèi)型
D.整數(shù)類(lèi)型

1.填空題塊語(yǔ)句有兩種，一種是begin-end語(yǔ)句，通常用來(lái)標(biāo)志（）執(zhí)行的語(yǔ)句；一種是fork-join語(yǔ)句，通常用來(lái)標(biāo)志（）執(zhí)行的語(yǔ)句。

2.填空題一個(gè)大型的組合電路總延時(shí)為100ns，采用流水線將它分為兩個(gè)較小的組合電路，理論上電路最高工作頻率可達(dá)（）MHz。

3.填空題Verilog 語(yǔ)言規(guī)定的兩種主要的數(shù)據(jù)類(lèi)型分別是 wire(或 net) 和 reg 。程序模塊中輸入，輸出信號(hào)的缺省類(lèi)型為（）。

4.填空題Verilog語(yǔ)言規(guī)定了邏輯電路中信號(hào)的4種狀態(tài)，分別是0，1，X和Z。其中0表示低電平狀態(tài)，1表示高電平狀態(tài)，X表示不定態(tài)（或未知狀態(tài)），Z表示（）。

5.填空題你所知道的可編程邏輯器件有（至少兩種）：（）。