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填空題狀態(tài)機常用狀態(tài)編碼有（）。

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1.填空題EDA縮寫的含義為（）

參考答案：電子設(shè)計自動化(Electronic Design Automation)

2.填空題有限狀態(tài)機分為（）和Mealy兩種類型。

3.問答題 試使用 Verilog HDL 設(shè)計一個 10 進(jìn)制計數(shù)器，規(guī)定模塊定義為 modulecount10(out,clr,clk),其中 clk 為時鐘輸入，clr 為同步清零輸入，低電平有效，out 為計數(shù)器輸出。
（1）寫出 10 進(jìn)制計數(shù)器 Verilog HDL 設(shè)計程序并注釋；
（2）寫出 10 進(jìn)制計數(shù)器 Verilog HDL 測試文件并注釋；

參考答案：

4.問答題試設(shè)計一個 3/8 譯碼器，規(guī)定模塊定義為 module Decoder(Out,In,En),其中 Out為譯碼器輸出，In 為譯碼器輸入，En 為譯碼使能輸入。要求：寫出 3/8 譯碼器 Verilog HDL設(shè)計程序并注釋.

參考答案：

5.單項選擇題Verilog語言與C語言的區(qū)別，不正確的描述是（）

A.Verilog語言可實現(xiàn)并行計算，C語言只是串行計算；
B.Verilog語言可以描述電路結(jié)構(gòu)，C語言僅僅描述算法；
C.Verilog語言源于C語言，包括它的邏輯和延遲；
D.Verilog語言可以編寫測試向量進(jìn)行仿真和測試。

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