如圖所示的差分放大電路中，為了使輸入電壓為零時(shí)，輸出電壓也為零，加入了調(diào)零電位器RP。已知β1=β2=50，uBE1=uBE2=0.7V，Rc=10kΩ，RS=1kΩ，RP=200Ω，Re=10kΩ，RL=0.15kΩ，VCC=15v。那么ICQ為（），UCQ為（）及差模電壓增益AVd為（）。
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最新試題
?電路如圖所示，如果電容C2開路，則MOSFET的漏極直流電壓將會(huì)（），漏極交流電壓將會(huì)（），增益將會(huì)（）。
?CG放大器的性能描述合理的是（）。
?5.1K±5%歐姆的五環(huán)電阻的色環(huán)序列為（）。
CD放大器因?yàn)樵礃O輸出信號(hào)幾乎與柵極輸入信號(hào)變化一致，因此被稱為“源極跟隨器”。
?在verilogHDL的數(shù)字表達(dá)方式用，和十進(jìn)制數(shù)127表示的數(shù)字相同的表達(dá)方式有（）。
?verilog語法中，間隔符號(hào)主要包括（）。
?CS放大器中引入源極電阻RS，其作用有（）。?
用作電壓放大器時(shí)，CS放大器不合適的參數(shù)為（）。?
?TTL或非門組成的邏輯電路如圖所示，當(dāng)輸入為以下哪種狀態(tài)時(shí)會(huì)出現(xiàn)冒險(xiǎn)現(xiàn)象？（）
?已知Nexys4開發(fā)板外部時(shí)鐘信號(hào)頻率為100MHz，數(shù)字鐘用來產(chǎn)生秒信號(hào)的時(shí)鐘信號(hào)頻率為1Hz，若采用計(jì)數(shù)器對(duì)100MHz的外部時(shí)鐘分頻得到1Hz的秒信號(hào)，請(qǐng)問該計(jì)數(shù)器至少需要多少位？（）