圖中,設(shè)二極管是理想的,U1=20V,U2=15V,R1=18kΩ,R2=2kΩ,R3=25kΩ,R4=5kΩ,R5=140kΩ,R6=10kΩ,通過計(jì)算判斷圖中的二極管是導(dǎo)通還是截止?
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最新試題
?已知Nexys4開發(fā)板外部時(shí)鐘信號(hào)頻率為100MHz,數(shù)字鐘用來產(chǎn)生秒信號(hào)的時(shí)鐘信號(hào)頻率為1Hz,若采用計(jì)數(shù)器對(duì)100MHz的外部時(shí)鐘分頻得到1Hz的秒信號(hào),請(qǐng)問該計(jì)數(shù)器至少需要多少位?()
?10進(jìn)制計(jì)數(shù)器模塊在數(shù)字鐘系統(tǒng)中可作為以下哪些模塊的子模塊?()
I=0.5mA,Vt=1.5V,k′n(W/L)=1mA/V2,VA足夠大。輸入輸出信號(hào)均通過電容耦合進(jìn)行傳輸(注意圖中未畫出電容),要實(shí)現(xiàn)增益為15倍的放大電路,則RD=()kΩ。?
?CS、CG和CD三種組態(tài)中,最適合做電壓放大器的還是CS放大器。
?CG放大器的性能描述合理的是()。
用作電壓放大器時(shí),CS放大器不合適的參數(shù)為()。?
?某次電路實(shí)驗(yàn)中,一同學(xué)按如下電路圖連接電路,完成實(shí)驗(yàn)。其中D0,D1端為輸入端,S0與S1為輸出端。在實(shí)驗(yàn)過程中,該同學(xué)觀測(cè)到輸出端S0,S1端輸出電平分別為邏輯高電平,邏輯低電平。請(qǐng)問此刻電路輸入端D0,D1電平可能分別為()。
CD放大器具有較()的輸入電阻和較()的輸出電阻。?????
?verilog語法中,間隔符號(hào)主要包括()。
?在verilogHDL的數(shù)字表達(dá)方式用,和十進(jìn)制數(shù)127表示的數(shù)字相同的表達(dá)方式有()。