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計(jì)算機(jī)科學(xué)VHDL語(yǔ)言問答題每日一練(2019.05.12)
來(lái)源:考試資料網(wǎng)
1.問答題
簡(jiǎn)述VHDL程序的基本結(jié)構(gòu)。
參考答案:
庫(kù) library ieee;
程序包 use ieee std_logic_1164.all;
實(shí)...
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2.問答題
VHDL是否區(qū)分大小寫?
參考答案:
不區(qū)分
3.問答題
VHDL語(yǔ)言的變量和信號(hào)有什么區(qū)別?
參考答案:
1,信號(hào)賦值是有一定延遲的,而變量賦值是沒有延遲的,
2,對(duì)于進(jìn)程語(yǔ)句來(lái)說,進(jìn)程只對(duì)信號(hào)敏感,而不對(duì)變量敏感<...
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4.問答題
簡(jiǎn)述VHDL語(yǔ)言與計(jì)算機(jī)語(yǔ)言的差別。
參考答案:
運(yùn)行的基礎(chǔ)
–計(jì)算機(jī)語(yǔ)言是在CPU+RAM構(gòu)建的平臺(tái)上運(yùn)行
–VHDL設(shè)計(jì)的...
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5.問答題
編寫一個(gè)數(shù)值比較器VHDL程序的進(jìn)程(不必寫整個(gè)結(jié)構(gòu)框架),要求使能信號(hào)g低電平時(shí)比較器開始工作,輸入信號(hào)p=q,輸出equ為‘0’,否則為‘1’。
參考答案: