計(jì)算機(jī)科學(xué)VHDL語(yǔ)言判斷題每日一練(2019.07.26)

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1.判斷題Moore狀態(tài)機(jī)輸出只是狀態(tài)機(jī)當(dāng)前狀態(tài)的函數(shù)，Mealy狀態(tài)機(jī)輸出為有限狀態(tài)機(jī)當(dāng)前值和輸入值的函數(shù)

2.判斷題進(jìn)程語(yǔ)句中，不管在何時(shí)，process語(yǔ)句后面必須列出敏感信號(hào)

3.判斷題CONSTANT T2：std_logic <= ’0’;

4.判斷題CONSTANT T2：std_logic <= ’0’;

5.判斷題一個(gè)VHAL程序中僅能使用一個(gè)進(jìn)程（process）語(yǔ)句。