單項(xiàng)選擇題下列表達(dá)式中，代表“或”邏輯的是（）
A.F=A⊕B
B.F=A+B
C.F=A⊙B
D.F=（A*B）！
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1.單項(xiàng)選擇題十進(jìn)制38數(shù)轉(zhuǎn)換成二進(jìn)制數(shù)為（）
A.100100
B.110100
C.100101
D.100110
2.單項(xiàng)選擇題十進(jìn)制37數(shù)轉(zhuǎn)換成二進(jìn)制數(shù)為（）
A.100100
B.100101
C.110100
D.100110
3.單項(xiàng)選擇題邏輯函數(shù)（a*b）！+a*b*c，簡化后的結(jié)果是（）
A.b+c
B.0
C.（a*b）！+c
D.1
4.單項(xiàng)選擇題邏輯關(guān)系式A⊕A=（）。
A.1
B.0
C.A!
D.A
5.單項(xiàng)選擇題邏輯關(guān)系式A⊙A=（）
A.0
B.1
C.A！
D.A
最新試題
?verilogHDL中已經(jīng)預(yù)先定義了的門級原型的符號有（）。
題型：多項(xiàng)選擇題
一塊通用面包板，公共條是三?四?三分段連通型，那么這塊板上最多有（）個插孔在內(nèi)部是連通在一起的。
題型：單項(xiàng)選擇題
?在使用verilog描述一個二選一的數(shù)據(jù)選擇器時，使用一條語句來進(jìn)行描述assign out1=（sel &b）∣（~sel &a），這條語句對應(yīng)的是（）。
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?數(shù)字頻率計(jì)設(shè)計(jì)中的測頻計(jì)數(shù)模塊共有多少個狀態(tài)？（）
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假設(shè)NEMOSFET已工作在飽和區(qū)，若uDS繼續(xù)增大時，溝道夾斷點(diǎn)向漏極移動。
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CD放大器具有較（）的輸入電阻和較（）的輸出電阻。?????
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用作電壓放大器時，CS放大器不合適的參數(shù)為（）。?
題型：單項(xiàng)選擇題
可以通過新增以下哪些類型文件添加ChipScope調(diào)試IP核？（）
題型：多項(xiàng)選擇題
在下圖中如果輸入輸出均有電容耦合，則將RG的阻值由10MΩ替換為1MΩ時，柵極直流電壓將會（），漏極直流電流將會（），輸入電阻將會（）。
題型：單項(xiàng)選擇題