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計(jì)算機(jī)程序設(shè)計(jì)VHDL考試問答題每日一練(2019.01.15)

來源：考試資料網(wǎng)

1.問答題標(biāo)示符與保留字有何不同？對(duì)VHDL編程有何約束？

參考答案：標(biāo)識(shí)符用于命名實(shí)體、結(jié)構(gòu)體、信號(hào)和變量等。
V.HDL語言中的保留字不可以用于標(biāo)識(shí)符的命名中，保留字有些用于V...

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2.問答題什么是現(xiàn)代電子設(shè)計(jì)？

參考答案：電子設(shè)計(jì)分為古典電子設(shè)計(jì)和現(xiàn)代電子設(shè)計(jì)兩種。把利用分立元件，通用芯片，進(jìn)行板上電子系統(tǒng)的設(shè)計(jì)稱為古典電子設(shè)計(jì)。利用IP模...

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3.問答題為什么VHDL設(shè)計(jì)僅需要功能仿真？

參考答案：VHDL 設(shè)計(jì)硬件電路，以功能設(shè)計(jì)為設(shè)計(jì)目標(biāo)，與具體的集成電路工藝無關(guān)。在不同工藝條件下，時(shí)序延時(shí)是不同的。由...

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4.問答題為什么集成電路設(shè)計(jì)版圖設(shè)計(jì)需要時(shí)序仿真？

參考答案：集成電路版圖設(shè)計(jì)的前提是在某一特定的工藝條件下，進(jìn)行芯片的物理層設(shè)計(jì)，由于不同工藝時(shí)序不同，所以需要時(shí)序仿真，同時(shí)也需要...

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5.問答題Moore型狀態(tài)機(jī)和Mealy型狀態(tài)機(jī)有什么相同和不同？

參考答案：