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計(jì)算機(jī)程序設(shè)計(jì)VHDL考試問答題每日一練(2019.01.22)

來源：考試資料網(wǎng)

1.問答題為什么集成電路設(shè)計(jì)版圖設(shè)計(jì)需要時(shí)序仿真？

參考答案：集成電路版圖設(shè)計(jì)的前提是在某一特定的工藝條件下，進(jìn)行芯片的物理層設(shè)計(jì)，由于不同工藝時(shí)序不同，所以需要時(shí)序仿真，同時(shí)也需要...

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2.問答題什么是對(duì)象？對(duì)象有哪幾種類型？

參考答案：在VHDL語言中，對(duì)象（Objects）是具有特定數(shù)據(jù)類型且可以被賦值的客體。
VHDL語言中的對(duì)象有4類：常...

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3.問答題用結(jié)構(gòu)化描述方法設(shè)計(jì)一個(gè)加法器。

參考答案：

4.問答題配置說明中的映射有哪兩種方法？

參考答案：形式端口與實(shí)際端口可以是名字關(guān)聯(lián)映射，也可以是位置順序關(guān)聯(lián)映射。

5.問答題簡答VHDL設(shè)計(jì)用FPGA實(shí)現(xiàn)的意義。

參考答案：可編程器件FPGA具有容量大、密度高等特點(diǎn)，是科學(xué)實(shí)驗(yàn)、小批量生產(chǎn)、樣機(jī)研制的載體。這種產(chǎn)品形態(tài)可以作為科學(xué)實(shí)驗(yàn)、小批量...

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