A.總線鎖定
B.地址鎖定
C.數(shù)據(jù)輸入鎖定
D.數(shù)據(jù)輸出鎖定
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A.上升沿
B.下降沿
C.結(jié)束位置
D.中間位置
A.HOLD、TEST、READY
B.READY
C.M/IO、HOLD、TEST
組成最大模式下的最小系統(tǒng)，除CPU、時(shí)鐘電路，ROM，RAM及I/O接口外，至少需增加的芯片類型為（）。
a.總線控制器
b.總線裁決器
c.地址鎖存器
d.總線驅(qū)動(dòng)器
A.b，d
B.a，b，c
C.a，d
D.a，c，d
A.中斷優(yōu)先級(jí)控制器
B.總線控制器
C.數(shù)據(jù)驅(qū)動(dòng)器
D.地址鎖存器
A.可以擴(kuò)展存儲(chǔ)容量
B.可以擴(kuò)大I/O空間
C.可以構(gòu)成多處理器系統(tǒng)
D.可以提高CPU主頻
最新試題
8086CPU讀取外設(shè)端口數(shù)據(jù)時(shí)，一次可以讀取16位二進(jìn)制數(shù)。（）
只要讀取8086CPU存儲(chǔ)器偶地址存儲(chǔ)體內(nèi)容時(shí)，BHE#=1，A0=0。（）
在I2C總線中，應(yīng)答信號(hào)始終由從機(jī)發(fā)出。
I2C總線的通信速率僅由主機(jī)確定。
在IN和OUT指令中，當(dāng)端口號(hào)大于FFH（255）時(shí)，必須通過（）間接給出。
下列選項(xiàng)中不屬于使用中斷的優(yōu)勢的選項(xiàng)是（）。
通過條件轉(zhuǎn)移指令JXX可以實(shí)現(xiàn)分支結(jié)構(gòu)程序的編寫。（）
在查詢式輸出接口典型電路中，數(shù)據(jù)端口地址和狀態(tài)端口地址可以是相同地址。（）
I2C總線的多主機(jī)仲裁是依靠兩條信號(hào)線的開漏輸出與上位電阻形成的（）實(shí)現(xiàn)的。
要組成32M×8bit的存儲(chǔ)器，需要1M×4bit的存儲(chǔ)芯片共（）片。