A.算術(shù)邏輯運(yùn)算單元
B.控制器
C.通用寄存器組
D.I/O總線
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A.X·Y
B.
C.
D.X+Y
A.F9
B.F0
C.89
D.80
A.每秒鐘所能執(zhí)行的指令條數(shù)
B.存儲(chǔ)器讀寫速度
C.計(jì)算機(jī)即時(shí)存儲(chǔ)信息的能力
D.該計(jì)算機(jī)保存大量信息的能力
A."1"的個(gè)數(shù)為奇數(shù)
B."1"的個(gè)數(shù)為偶數(shù)
C.最低位為"1"
D.最高位為"1"
A.DRAM
B.EPROM
C.SRAM
D.EEPROM
A.時(shí)鐘周期大于機(jī)器周期
B.時(shí)鐘周期等于機(jī)器周期
C.機(jī)器周期大于指令周期
D.指令周期大于時(shí)鐘周期
若用8位機(jī)器碼表示二進(jìn)制數(shù)-111，則原碼表示的十六進(jìn)制形式為_(kāi)_（1）___；補(bǔ)碼表示的十六進(jìn)制形式為_(kāi)_（2）__。
空白（1）處應(yīng)選擇（）
A.81
B.87
C.OF
D.FF
A.4
B.6
C.8
D.10
A.7FFFH
B.8FFFH
C.9FFFH
D.AFFFH
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B.控制器
C.通用寄存器組
D.I/O總線
最新試題
空白（2）處應(yīng)選擇（）
設(shè)內(nèi)存按字節(jié)編址，若8K×8bit存儲(chǔ)空間的起始地址為7000H，則該存儲(chǔ)空間的最大地址編號(hào)為（）。
中央處理單元（CPU）不包括（）。
空白（2）處應(yīng)選擇（）
以下關(guān)于精簡(jiǎn)指令集計(jì)算機(jī)（RISC）指令系統(tǒng)特點(diǎn)的敘述中，錯(cuò)誤的是（）。
以下關(guān)于CPU與主存之間增加高速緩存（Cache）的敘述中，錯(cuò)誤的是（）。
計(jì)算機(jī)中，執(zhí)行一條指令所需要的時(shí)間稱為指令周期，完成一項(xiàng)基本操作所需要的時(shí)間稱為機(jī)器周期，時(shí)鐘脈沖的重復(fù)周期稱為時(shí)鐘周期。因此（）。
用（）時(shí)，校驗(yàn)位與信息位交叉設(shè)置。
某邏輯電路有兩個(gè)輸入端和一個(gè)輸出端，輸入端用X和Y表示，輸出端用Z表示。當(dāng)且僅當(dāng)X和y同時(shí)為1時(shí)，Z才為0，則該電路的邏輯表達(dá)式為（）。
空白（1）處應(yīng)選擇（）