A.大于
B.小于
C.相等
D.不確定
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A.觸發(fā)器
B.計(jì)數(shù)器
C.數(shù)據(jù)分配器
D.數(shù)據(jù)選擇器
A.不含記憶電路
B.不含反饋電路
C.從輸入端開(kāi)始單向傳輸?shù)捷敵?
D.任何時(shí)候的輸出僅與當(dāng)時(shí)的輸入有關(guān)
A.引入封鎖脈沖
B.引入選通脈沖
C.接入濾波電容
D.修改邏輯設(shè)計(jì)，增加冗余項(xiàng)
A.化簡(jiǎn)函數(shù)表達(dá)式
B.列出真值表
C.說(shuō)明給定電路的基本功能
D.根據(jù)最簡(jiǎn)輸出函數(shù)表達(dá)式畫(huà)出邏輯圖
A.根據(jù)給定的邏輯圖寫(xiě)出輸出邏輯函數(shù)表達(dá)式
B.化簡(jiǎn)函數(shù)表達(dá)式
C.列出真值表
D.根據(jù)最簡(jiǎn)輸出函數(shù)表達(dá)式畫(huà)出邏輯圖
最新試題
兩個(gè)與非門(mén)構(gòu)成的基本RS觸發(fā)器，當(dāng)Q=1、Q=0時(shí)，兩個(gè)輸入信號(hào)R=1和S=1。觸發(fā)器的輸出Q會(huì)（）。
27系列EPROM存儲(chǔ)的數(shù)據(jù)是（）可擦除的。
什么是觸發(fā)器的空翻現(xiàn)象，如何避免空翻？
判斷如下VHDL的操作是否正確，如不正確，請(qǐng)改正。字符a和b的數(shù)據(jù)類(lèi)型是BIT，c是INTEGER，執(zhí)行c＜=a+b。
如要將一個(gè)最大幅度為5.1V的模擬信號(hào)轉(zhuǎn)換為數(shù)字信號(hào)，要求輸入每變化20mV，輸出信號(hào)的最低位（LSB）發(fā)生變化，應(yīng)選用（）位ADC。
與倒T形電阻網(wǎng)絡(luò)DAC相比，權(quán)電流網(wǎng)絡(luò)D/A轉(zhuǎn)換器的主要優(yōu)點(diǎn)是消除了（）對(duì)轉(zhuǎn)換精度的影響。
要使JK觸發(fā)器的輸出Q從1就成0，它的輸入信號(hào)JK就為（）。
一個(gè)16選一的數(shù)據(jù)選擇器，其地址輸入（選擇控制輸入）端有（）個(gè)。
若停電數(shù)分鐘后恢復(fù)供電，（）中的信息能夠保持不變。
如果把D觸發(fā)器的輸出Q反饋連接到輸入D，則輸出Q的脈沖波形的頻率為CP脈沖頻率f的（）。