A.程序控制輸入輸出方式
B.中斷輸入輸出方式
C.直接存儲器訪問方式
D.上述3種方式
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A.增加cache中的塊數(shù)
B.增大組的大小
C.增大主存容量
D.增大塊的大小
A.同一條指令的讀操作與寫操作之間的寫后讀沖突。
B.先流入的指令的寫操作與后流入的指令的讀操作之間的寫后讀沖突
C.后流入的指令的寫操作與先流入的指令的讀操作之間的讀后寫沖突
D.兩條指令的寫操作之間的寫后寫沖突
A.目錄表小
B.塊沖突概率低
C.命中率高
D.主存利用率高
A.擴大存儲系統(tǒng)的容量
B.提高存儲系統(tǒng)的速度
C.擴大存儲系統(tǒng)的容量和提高存儲系統(tǒng)的速度
D.便于程序的訪存操作
A.主存地址
B.邏輯地址
C.物理地址
D.有效地址
最新試題
假設(shè)在3000次訪存中,第一級Cache不命中110次,第二級Cache不命中55次。試問:在這種情況下,該Cache系統(tǒng)的局部不命中率和全局不命中率各是多少?
共需要多少個觸發(fā)器和多少個與門?
如果一條指令的執(zhí)行過程分解為“取指令”和“分析”兩個階段,并采用兩級流水線。為了采用指令取消技術(shù),請修改上面的程序。
浮點數(shù)系統(tǒng)使用的階碼基值re=2,階值位數(shù)q=2,尾數(shù)基值rm=10,尾數(shù)位數(shù)p′=1,即按照使用的二進制位數(shù)來說,等價于p=4。計算在非負階、正尾數(shù)、規(guī)格化情況下的最小尾數(shù)值、最大尾數(shù)值、最大階值、可表示的最小值和最大值及可表示數(shù)的個數(shù)。
有一個16KB4路組相聯(lián)Cache的32位微處理器,假定該Cache的塊為4個32位的字。主存地址為ABCDE8F8的單元在Cache中的什么位置。
在編號分別為0,1,2,……,9的16個處理器之間,要求按下列配對通信:(B、1),(8、2),(7、D),(6、C),(E、4),(A、0),(9、3),(5、F)。試選擇所用互連網(wǎng)絡(luò)類型、控制方式,并畫出該互連網(wǎng)絡(luò)的拓撲結(jié)構(gòu)和各級的交換開關(guān)狀態(tài)圖。
畫出其中一組的邏輯圖。
畫出流水線任務調(diào)度的狀態(tài)有向圖。
寫出主存地址和Cache地址的格式,并標出各字段的長度。
僅根據(jù)使用頻度,不考慮其它要求,設(shè)計出全Huffman操作碼,計算其平均碼長。