單項(xiàng)選擇題編碼器，譯碼器為（）
A.組合邏輯電路
B.時(shí)序邏輯電路
C.脈沖電路
D.基本邏輯門電路
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1.單項(xiàng)選擇題按觸發(fā)器的CP所決定的狀態(tài)轉(zhuǎn)換區(qū)分，計(jì)數(shù)器可分為（）計(jì)數(shù)器。
A.加法、減法
B.同步和異步
C.二、十和N進(jìn)制
D.可逆
2.單項(xiàng)選擇題T觸發(fā)器的邏輯功能是（）
A.置0、置1
B.置0、置1、保持
C.置0、置1、保持、翻轉(zhuǎn)
D.保持、翻轉(zhuǎn)
3.單項(xiàng)選擇題JK觸發(fā)器J與K相接作為一個(gè)輸入時(shí)相當(dāng)于（）觸發(fā)器。
A.JK
B.T
C.D
4.單項(xiàng)選擇題CMOS反相器的優(yōu)點(diǎn)是（）
A.易飽和和截止
B.易維修
C.功耗小
D.功耗高
5.單項(xiàng)選擇題4位寄存器至少需要（）個(gè)觸發(fā)器構(gòu)成。
A.2
B.3
C.4
D.8
最新試題
CG放大器具有較（）的輸入電阻和較（）的輸出電阻。?
題型：單項(xiàng)選擇題
?verilogHDL的基本結(jié)構(gòu)中通常需要進(jìn)行模塊范圍的定義，VerilogHDL的模塊范圍的定義的開始和結(jié)束方式是（）。
題型：單項(xiàng)選擇題
?CG放大器的性能描述合理的是（）。
題型：單項(xiàng)選擇題
I=0.5mA，Vt=1.5V，k′n（W/L）=1mA/V2，VA足夠大。輸入輸出信號均通過電容耦合進(jìn)行傳輸（注意圖中未畫出電容），要實(shí)現(xiàn)增益為15倍的放大電路，則RD=（）kΩ。?
題型：單項(xiàng)選擇題
已知某N溝道增強(qiáng)型MOS場效應(yīng)管的。下表給出了四種狀態(tài)下和的值，那么各狀態(tài)下器件的工作狀態(tài)為（）。
題型：多項(xiàng)選擇題
?MOSFET源極漏極間的長度L越大，溝道長度調(diào)制效應(yīng)越明顯。???
題型：判斷題
?數(shù)字頻率計(jì)采用4個(gè)數(shù)字的BCD碼計(jì)數(shù)器，若采樣時(shí)間0.01s，那么它能夠測量的最大頻率是多少？（）
題型：單項(xiàng)選擇題
CD放大器具有較（）的輸入電阻和較（）的輸出電阻。?????
題型：單項(xiàng)選擇題
?若某放大器的輸入信號為電壓信號，輸出信號為電流信號，則以下描述正確的有（）。?
題型：多項(xiàng)選擇題
?verilog語法中，間隔符號主要包括（）。
題型：多項(xiàng)選擇題