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圖中所示的是雙2選1多路選擇器構(gòu)成的電路MUXK，對于其中MUX21A，當s=‘0’和‘1’時，分別有y<=‘a’和y<=‘b’。試在一個結(jié)構(gòu)體中用兩個進程來表達此電路，每個進程中用CASE語句描述一個2選1多路選擇器MUX21A。

圖中所示的是4選1多路選擇器，試用CASE語句的表達方式寫出此電路的VHDL程序。
選擇控制的信號s1和s0為STD_LOGIC_VECTOR類型；
當s1=‘0’，s0=‘0’；s1=‘0’，s0=‘1’；s1=‘1’，s0=‘0’和s1=‘1’，s0=‘1’分別執(zhí)行y<=a、y<=b、y<=c、y<=d。