A.地址寄存器
B.地址寄存器和指令寄存器
C.地址寄存器和數(shù)據(jù)緩沖寄存器
D.地址寄存器、數(shù)據(jù)緩沖寄存器和指令寄存器
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A.階碼部件可實現(xiàn)加、減、乘、除四種運算
B.階碼部件只進行階碼相加、相減和比較操作
C.階碼部件只進行階碼相加、相減操作
D.尾數(shù)部件只進行乘法和除法運算
A.一個以上,與非門
B.一個,三態(tài)緩沖器
C.n個,三態(tài)緩沖器
D.n個以上,或非門
A.非晶硅
B.單晶硅
C.多晶硅
D.硫化鎘
最新試題
如果把一條指令的執(zhí)行過程分解為“取指令”、“分析”(包括譯碼和取操作數(shù)等)和“執(zhí)行”(包括運算和寫回結果等)三個階段,并采用三級流水線。仍然要采用指令取消技術,請修改上面的程序。
假設在3000次訪存中,第一級Cache不命中110次,第二級Cache不命中55次。試問:在這種情況下,該Cache系統(tǒng)的局部不命中率和全局不命中率各是多少?
當存儲系統(tǒng)的訪問效率為0.5時,計算命中率和等效訪問周期。
要求操作碼的平均長度最短,請設計操作碼的編碼,并計算操作碼編碼的平均長度。
設計8位字長的寄存器—寄存器型指令3條,16位字長的寄存器一存儲器型變址尋址方式指令4條,變址范圍不小于正、負127。請設計指令格式,并給出指令各字段的長度和操作碼的編碼。
一臺機器要求浮點數(shù)的字長的精度不低于10-7.2,表數(shù)的范圍正數(shù)不小于1038,且正負對稱。尾數(shù)用原碼、純小數(shù)表示,階碼用移碼、整數(shù)表示。設計這種浮點數(shù)的格式。
為了使存儲系統(tǒng)的訪問效率達到0.94,命中率和等效訪問周期應該提高到多少?
寫出N=8的蝶式置換的互連函數(shù),如采用Omega網(wǎng)絡,則需幾次通過才能完成此變換?畫出Omega網(wǎng)絡實現(xiàn)此變換的控制狀態(tài)圖。
共需要多少個觸發(fā)器和多少個與門?
若在程序執(zhí)行過程中,每從主存裝入一塊到Cache,平均要對這個塊訪問16次,計算在這種情況下的Cache命中率。