A.CPU從主存取出一條指令的時(shí)間
B.CPU執(zhí)行一條指令的時(shí)間
C.CPU從主存取出一條指令加上執(zhí)行這條指令的時(shí)間
D.時(shí)鐘周期時(shí)間
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A.地址譯碼器
B.指令譯碼器
C.地址寄存器
D.指令寄存器
A.進(jìn)行加法運(yùn)算,因?yàn)樗械挠?jì)算都可以轉(zhuǎn)變?yōu)榧臃?br />
B.進(jìn)行整數(shù)運(yùn)算和浮點(diǎn)數(shù)運(yùn)算
C.執(zhí)行用二進(jìn)制編寫的程序
D.進(jìn)行算術(shù)運(yùn)算和邏輯運(yùn)算
A.CPU訪問存儲(chǔ)器的時(shí)間是由存儲(chǔ)器的容量決定的,存儲(chǔ)器容量越大,訪問存儲(chǔ)器所需的時(shí)間越長
B.大多數(shù)個(gè)人計(jì)算機(jī)中可配置的內(nèi)存容量僅受地址總線位數(shù)限制
C.因?yàn)閯?dòng)態(tài)存儲(chǔ)器是破壞性讀出,所以必須不斷地刷新
D.一般情況下,ROM和RAM在存儲(chǔ)體中是統(tǒng)一編址的
最新試題
在計(jì)算機(jī)中,保存當(dāng)前正在執(zhí)行的指令的寄存器為(1),存放當(dāng)前指令地址的寄存器叫(2)。在順序執(zhí)行指令的情況下(存儲(chǔ)器按字節(jié)編址,指令字長32位),每執(zhí)行一條指令,使程序計(jì)數(shù)器自動(dòng)加(3)。算術(shù)邏輯運(yùn)算的結(jié)果通常放在(4)中。空白(3)處應(yīng)選擇()
在計(jì)算機(jī)中,保存當(dāng)前正在執(zhí)行的指令的寄存器為(1),存放當(dāng)前指令地址的寄存器叫(2)。在順序執(zhí)行指令的情況下(存儲(chǔ)器按字節(jié)編址,指令字長32位),每執(zhí)行一條指令,使程序計(jì)數(shù)器自動(dòng)加(3)。算術(shù)邏輯運(yùn)算的結(jié)果通常放在(4)中??瞻祝?)處應(yīng)選擇()
單地址指令中為了完成兩個(gè)數(shù)的算術(shù)運(yùn)算,除地址碼指明的一個(gè)操作數(shù)外,另一個(gè)數(shù)常需采用()。
在CPU的寄存器中,PSW用來存放()。
在計(jì)算機(jī)中,保存當(dāng)前正在執(zhí)行的指令的寄存器為(1),存放當(dāng)前指令地址的寄存器叫(2)。在順序執(zhí)行指令的情況下(存儲(chǔ)器按字節(jié)編址,指令字長32位),每執(zhí)行一條指令,使程序計(jì)數(shù)器自動(dòng)加(3)。算術(shù)邏輯運(yùn)算的結(jié)果通常放在(4)中??瞻祝?)處應(yīng)選擇()
如果主存容量為16MB,且按字節(jié)編址,表示該主存地址至少應(yīng)需要()位。
某寄存器中的值有時(shí)是數(shù)值,有時(shí)又是地址,這只有計(jì)算機(jī)的()才能識(shí)別它。
若內(nèi)存按字節(jié)編址,用存儲(chǔ)容量為4Kb×8的存儲(chǔ)器芯片構(gòu)成地址編號(hào)8000H至FFFFH的內(nèi)存空間,則至少需要()片。
下列敘述中正確的是()。
CPU組成中不包括()。