多項選擇題在下列觸發(fā)器中，有約束條件的是（）。
A.主從JK觸發(fā)器
B.主從D觸發(fā)器
C.同步RS觸發(fā)器
D.邊沿D觸發(fā)器
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1.多項選擇題組合邏輯電路中輸入信號的變化傳輸?shù)诫娐犯骷壖砷T時，在時間上有先有后，這種先后所形成的時差稱為競爭，競爭一般分為（）。
A.冒險競爭
B.安全競爭
C.功能競爭
D.邏輯競爭
2.多項選擇題74LS138是（）。
A.集成3線－8線譯碼器
B.集成3線－8線數(shù)據(jù)選擇器
C.集成8線－3線譯碼器
D.集成3線－8線數(shù)據(jù)分配器
3.多項選擇題將十進制數(shù)的10個數(shù)字0～9編成二進制代碼的電路稱為（）。
A.8421BCD編碼器
B.二進制編碼器
C.二－十進制編碼器
D.十進制編碼器
4.多項選擇題常見的譯碼器有哪幾種。（）
A.變量譯碼器
B.優(yōu)先譯碼器
C.碼制變換譯碼器
D.顯示譯碼器
5.多項選擇題譯碼是編碼的逆過程，譯碼器的輸出可以是（）．
A.高電平
B.高阻
C.脈沖
D.低電平
最新試題
10-4線優(yōu)先編碼器允許同時輸入（）路編碼信號。
題型：單項選擇題
用1M×4的DRAM芯片通過（）擴展可以獲得4M×8的存儲器。
題型：單項選擇題
要使JK觸發(fā)器的輸出Q從1就成0，它的輸入信號JK就為（）。
題型：單項選擇題
如要將一個最大幅度為5.1V的模擬信號轉(zhuǎn)換為數(shù)字信號，要求輸入每變化20mV，輸出信號的最低位（LSB）發(fā)生變化，應選用（）位ADC。
題型：單項選擇題
TTL與非門輸出高電平的參數(shù)規(guī)范值是（）
題型：單項選擇題
判斷如下VHDL的操作是否正確，如不正確，請改正。字符a和b的數(shù)據(jù)類型是BIT，c是INTEGER，執(zhí)行c＜=a+b。
題型：問答題
兩個與非門構(gòu)成的基本RS觸發(fā)器，當Q=1、Q=0時，兩個輸入信號R=1和S=1。觸發(fā)器的輸出Q會（）。
題型：單項選擇題
如果把D觸發(fā)器的輸出Q反饋連接到輸入D，則輸出Q的脈沖波形的頻率為CP脈沖頻率f的（）。
題型：單項選擇題
什么是觸發(fā)器的不定狀態(tài)，如何避免不定狀態(tài)的出現(xiàn)？
題型：問答題
以下代碼中為無權(quán)碼的為（）。
題型：單項選擇題