單項(xiàng)選擇題一個8選1數(shù)據(jù)選擇器，其地址輸入（選擇控制輸入）端有幾個（）。
A.2
B.3
C.4
D.5
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1.單項(xiàng)選擇題下列邏輯電路中，不是組合邏輯電路的是（）。
A.譯碼器
B.加法器
C.寄存器
D.數(shù)據(jù)選擇器
2.單項(xiàng)選擇題下面對組合邏輯電路的功能特點(diǎn)描述錯誤的是（）。
A.輸出僅由輸入決定
B.電路的輸出與電路當(dāng)前狀態(tài)無關(guān)
C.電路結(jié)構(gòu)中無反饋環(huán)路
D.有記憶功能
3.單項(xiàng)選擇題在（）輸入情況下，“與非”運(yùn)算的結(jié)果是邏輯0。
A.全部輸入是0
B.任一輸入是0
C.僅一輸入是0
D.全部輸入是1
4.單項(xiàng)選擇題十進(jìn)制數(shù)25用8421BCD碼表示為（）。
A.10101
B.00100101
C.100101
D.10101
5.單項(xiàng)選擇題一位十六進(jìn)制數(shù)可以用（）位二進(jìn)制數(shù)來表示。
A.1
B.2
C.4
D.16
最新試題
什么是觸發(fā)器的空翻現(xiàn)象，如何避免空翻？
題型：問答題
一個16選一的數(shù)據(jù)選擇器，其地址輸入（選擇控制輸入）端有（）個。
題型：單項(xiàng)選擇題
如果把D觸發(fā)器的輸出Q反饋連接到輸入D，則輸出Q的脈沖波形的頻率為CP脈沖頻率f的（）。
題型：單項(xiàng)選擇題
7系列EPROM存儲的數(shù)據(jù)是（）可擦除的。
題型：單項(xiàng)選擇題
一個VHDL模塊是否必須有一個實(shí)體和一個結(jié)構(gòu)體？是否可以有多個實(shí)體和結(jié)構(gòu)體？簡述它們的作用。
題型：問答題
兩個與非門構(gòu)成的基本RS觸發(fā)器，當(dāng)Q=1、Q=0時，兩個輸入信號R=1和S=1。觸發(fā)器的輸出Q會（）。
題型：單項(xiàng)選擇題
TTL與非門輸出低電平的參數(shù)規(guī)范值是（）
題型：單項(xiàng)選擇題
用原碼輸出的譯碼器實(shí)現(xiàn)多輸出邏輯函數(shù)，需要增加若干個（）。
題型：單項(xiàng)選擇題
利用2個74LS138和1個非門，可以擴(kuò)展得到1個（）線譯碼器。
題型：單項(xiàng)選擇題
采用浮柵技術(shù)的EPROM中存儲的數(shù)據(jù)是（）可擦除的。
題型：單項(xiàng)選擇題