A.15V
B.10V
C.5V
D.2.5V
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A.雙門RC
B.三門RC環(huán)形
C.555構(gòu)成
D.石英晶體
A.Uoff
B.UT
C.UON
D.UOH
A.更多非門
B.電感L
C.RC環(huán)節(jié)
D.大容量電容
A.施密特觸發(fā)器
B.單穩(wěn)態(tài)觸發(fā)器
C.多諧振蕩器
D.集成定時(shí)器
A.可重觸發(fā)單穩(wěn)
B.單觸發(fā)單穩(wěn)
C.施密特觸發(fā)器
D.555定時(shí)器
最新試題
要使JK觸發(fā)器的輸出Q從1就成0，它的輸入信號JK就為（）。
用1M×4的DRAM芯片通過（）擴(kuò)展可以獲得4M×8的存儲(chǔ)器。
TTL與非門輸入短路電流IIS的參數(shù)規(guī)范值是（）。
兩個(gè)與非門構(gòu)成的基本RS觸發(fā)器，當(dāng)Q=1、Q=0時(shí)，兩個(gè)輸入信號R=1和S=1。觸發(fā)器的輸出Q會(huì)（）。
試提出數(shù)字頻率計(jì)的三種設(shè)計(jì)方案，比較各種方案的特點(diǎn)。如果用HDPLD來實(shí)現(xiàn)，設(shè)計(jì)方案是最佳嗎？簡述理由。
什么是觸發(fā)器的空翻現(xiàn)象，如何避免空翻？
用原碼輸出的譯碼器實(shí)現(xiàn)多輸出邏輯函數(shù)，需要增加若干個(gè)（）。
以下代碼中為無權(quán)碼的為（）。
利用2個(gè)74LS138和1個(gè)非門，可以擴(kuò)展得到1個(gè)（）線譯碼器。
一個(gè)兩輸入端的門電路，當(dāng)輸入為10時(shí)，輸出不是1的門電路為（）