假定某處理器帶有一個數(shù)據(jù)區(qū)容量為256B的cache，其塊大小為32B。以下C語言程序段運行在該處理器上，sizeof（int）= 4，編譯器將變量i，j，c，s都分配在通用寄存器中，因此，只要考慮數(shù)組元素的訪存情況。若cache采用直接映射方式，則當s=64和s=63時，缺失率分別為多少？若cache采用2-路組相聯(lián)映射方式，則當s=64和s=63時，缺失率又分別為多少？
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若在程序執(zhí)行過程中，每從主存裝入一塊到Cache，平均要對這個塊訪問16次，計算在這種情況下的Cache命中率。
寫出主存地址和Cache地址的格式，并標出各字段的長度。
在編號分別為0，1，2，……，9的16個處理器之間，要求按下列配對通信：（B、1），（8、2），（7、D），（6、C），（E、4），（A、0），（9、3），（5、F）。試選擇所用互連網(wǎng)絡類型、控制方式，并畫出該互連網(wǎng)絡的拓撲結(jié)構(gòu)和各級的交換開關狀態(tài)圖。
若Cache的4個塊號為C0、C1、C2和C3，列出程序執(zhí)行過程中的Cache塊地址流。
考慮題目全部要求，設計優(yōu)化實用的操作碼形式，并計算其操作碼的平均碼長。
一臺機器要求浮點數(shù)的字長的精度不低于10-7.2，表數(shù)的范圍正數(shù)不小于1038，且正負對稱。尾數(shù)用原碼、純小數(shù)表示，階碼用移碼、整數(shù)表示。設計這種浮點數(shù)的格式。
若對數(shù)字0～9和空格采用二進制編碼，試設計編碼平均長度最短的編碼。
指出主存與Cache之間各個塊的映象關系。
可能的最高頁命中率是多少？
為了使存儲系統(tǒng)的訪問效率從0.5提高到0.94，塊的大小至少增加到幾個字？