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單項(xiàng)選擇題

在VHDL的并行語(yǔ)句之間中，只能用（）來(lái)傳送信息。

A.變量
B.變量和信號(hào)
C.信號(hào)
D.常量

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單項(xiàng)選擇題

在VHDL語(yǔ)言中，用語(yǔ)句（）表示檢測(cè)到時(shí)鐘clk的上升沿。

A.clk’event
B.clk’event and clk = ‘1’
C.clk = ‘0’
D.clk’event and clk = ‘0’

單項(xiàng)選擇題

在VHDL中為目標(biāo)變量賦值符號(hào)為（）

A.＝
B.<＝
C.：=
D.=：

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